用触发器设计一个24进制的计数器,至少需要几个触发器-搜答案-百度作业网

用尺子量出你的数学书的厚度,再数下纸的张数,厚度除以张数就是一张纸的厚度.

看看吧PPThttp://bm.gduf.edu.cn/kcpt/szlj/%B5%DA%C1%F9%D5%C2%D2%EC%B2%BD%CA%B1%D0%F2%C2%DF%BC%AD%B5%E7%C

“带进位”指和的最高位为1,且位数比加数的位数大.如两位加法器,11+10=101得数已经超出了两位,最高位的1就是“进位”.正规的答案是：得数为01,进位为1.简单说带进位的,比不带进位的计数器,在

74ls161设计24进制计数的CAD.程序的最理想的有什么要求再问：状态是1——24，用手动脉冲触发再问：用两个161

完成一次计数要经过三触发器.时间为3*20纳秒,完成一次计数最少要最后的一个触发器状态发生改变.也就是前两个要产生给后一个的触发信号,第一个出发第二个要完成一次满程计数,即改变8个状态,第二个没改变一

触发器带载能力低,在后级与触发器间增加一级放大,就可以解决.再问：还是不行，好像是限流电阻的问题，改成数字电阻后可以仿真了，但电阻右侧开始还是不起振。再答：就是带载能力低造成的

编一个三菱的程序给你：X0－计数信号输入X1－复位按钮Y0－指示灯LDX0OUTC0K6LDX1RSTC0LDC0OUTY0END

具体过程就是那样的哦

Thisdesignhasasecond,minute,hour,day,month,multi-functionaldigitalclockcountingwasdisplayedin24-hour

第一题用2个触发器实现,高位Q1,低位Q0J0=Q1非,K0=Q1,J1=Q0,K1=Q0非时钟可用同步时序电路设计第二题为（Q3非*Q2）的非4至7的特点就是最高位是0,次高位是1

给你个参考,第7页,你自己去研究吧http://wenku.baidu.com/view/0400a177a417866fb84a8e35.html是好是坏,也没个回音,真不够意思

首先JK相连得到一个T触发器,输入T(就是JK),CTRL,输出Q设四个T的输出状态是Q3Q2Q1Q0也就是每高一级（每高一位）由低位来驱动T0123连1C0连CLKC1连Q0C2连Q1C3连Q2这样

书上写错了吧，应该是Q1(n)Q0(n)Q2(n)'+Q1(n)'Q2(n)+Q2(n)Q1(n)Q0(n)

这个你不能这样来分析，你应该从它的连接电路来分析，首先你要知道JK触发器的特征方程，然后结合特征方程和实际电路获得每一个触发器计数值是多少，然后再根据每一个触发器所占据的位置从而计算出它总得计数范围，

给你两种电路参考了...

我是凭直觉画的,正好用一片74ls74、一片74ls00,你必须画出波形图检验.补充：Z输出只占半个时钟宽度,是否合适?下图加一个触发器,电路类型又变了.

看看可以用吗

书上没有吗

74153TTL双4选1数据选择器

用PLC也行.还有就是用电子的计数器和定时器.